異步電路主要是組合邏輯電路，用于産生地址譯碼器、FIFO或RAM的讀寫控制信号脈沖，但它同時也用在時序電路中，此時它沒有統一的時鐘，狀态變化的時刻是不穩定的，通常輸入信号隻在電路處于穩定狀态時才發生變化。也就是說一個時刻允許一個輸入發生變化，以避免輸入信号之間造成的競争冒險。
同步電路是由時序電路和組合邏輯電路構成的電路，其所有操作都是在嚴格的時鐘控制下完成的。這些時序電路共享同一個時鐘CLK，而所有的狀态變化都是在時鐘的上升沿完成的。比如Ｄ觸發器，當上升延到來時，寄存器把Ｄ端的電平傳到Ｑ輸出端。在同步電路設計中一般采用D觸發器，異步電路設計中一般采用Latch。
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